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考试试题
换一换
[单项选择题]CC4000系列的CMOS门电路不能直接接()系列的门电路。
[单项选择题]如图电路,描述正确的是()。
[多项选择题]如图电路实现的逻辑函数是()。
[单项选择题]如图,是151的电路设计,其中输入端的使用了6个反相器,而实现逻辑功能应该可以省掉三个,为什么这么设计()。
[判断题]约束项在函数化简时可以当作1,是因为在实际电路中,这种输入组合根本不可能会让其发生。
[单项选择题]利用开关代数的公理或定理,判断与(x+y’)’等价的逻辑关系为()。
[多项选择题]数字设计的层次主要有()。
[单项选择题]已知函数F(A,B,C,D)=(AB’)’+(C’D+B’C)’,则其最简表达式为()。
[单项选择题]要使JK触发器在时钟脉冲作用下,实现输出,则输入信号应为()。
[单项选择题]为实现将D触发器转换为T触发器,下图所示电路的虚框内应是()。
[多项选择题]如图所示电路论述正确的是()。
[单项选择题]已知有二输入逻辑门,只有当输X和Y都为1时,输出F才为1,则X,Y与F的逻辑关系为()。
[判断题]若n个变量的同或运算和异或运算结果相同,则n为奇数()
[单项选择题]若集成块内部为驱动单元提供的驱动能力为1X,对于下图所示的输出缓冲设计(图中反相器上面标注了相应的驱动能力),该输出单元的延迟时间(从a到y)相当于()个内部标准门级联的延迟时间。
[单项选择题]如图,此电路的输入端I0_L是低电平有效,输出A2A1A0是高电平有效,AVALID有效表示的是()。
[单项选择题]当共阴极7段数码管显示2的时候,输出应该为()。
[单项选择题]BCD码译码器如果不允许输入大于9的数值的时候,当输入10时,输出为()。
[单项选择题]若集成块内部为驱动单元提供的驱动能力为1X,最小反相器(1X)延迟时间为2,对于下图所示的输出缓冲设计(图中反相器上面标注了相应的驱动能力),该输出单元的延迟时间(从a到y)最接近于()。
[单项选择题]十进制数22.37对应的二进制数是()。
[多项选择题]构成数字电路最基本的器件主要有()。
[判断题]TTL门电路具有负载能力强、抗干扰能力强和转换速度高等特点。
[多项选择题]关于集成块的输出单元,下列说法中正确的是()。
[多项选择题]逻辑函之间满足()关系。
[单项选择题]使用74HC138实现逻辑函数正确的是()。
[单项选择题]输出端不能直接线与的门电路有()。
[单项选择题]要使CMOS门输入高电平,不能使用的方法为()。
[单项选择题]下图逻辑单元实现的功能为()。
[多项选择题]对于D触发器,如果时钟频率为10MHz,输出信号Q的频率可能是()MHz。
[单项选择题]十进制数178.5对应的余3码是()。
[多项选择题]如图所示,则F=()。
[单项选择题]电路结构如图所示,该电路是()。
[单项选择题]要使TTL与非门变成反相器,多余的输入端不能采用的方法为()。
[多项选择题]与模拟电路相比,数字系统的优越性主要体现在()。
[多项选择题]二进制加法运算包含的输入、输出变量有()。
[单项选择题]若集成块内部为驱动单元提供的驱动能力为1X,最小反相器(1X)延迟时间为2,对于下图所示的输出缓冲设计(图中反相器上面标注了相应的驱动能力),该输出单元的延迟时间(从a到y)最接近于()。
[多项选择题]两个二进制数的补码相加,有溢出的是()。