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【简答题】为什么建议在编写Verilog模块程序时,如果用到if语句建议大家把配套的else情况也考虑在内?
答案:
因为如果没有配套的else语句,在不满足if条件语句时,将会保持原来的状态不变,从而在综合时会产生一个锁存器,而这是设计...
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答案:
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答案:
上面两个块执行起来效果是完全一样的,第一个模块是按顺序执行,而第二个模块是每个语句同时执行的。
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