单项选择题

下面从第47行开始的Verilog-HDL程序描述的是哪种组合逻辑模块的功能?

A.2线-4线二进制译码器
B.1线-2线二进制译码器
C.4线-16线二进制译码器
D.3线-8线二进制译码器
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