单项选择题时序逻辑电路的计数器取相应进制数少一经相应门电路送到()端。
A、异步清零端
B、同步清零端
C、异步置数端
D、同步置数端
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1.单项选择题下列不属于组合逻辑电路的加法器为()。
A、半加器
B、全加器
C、多位加法器
D、计数器
2.单项选择题下列不能用于构成组合逻辑电路的是()。
A、与非门
B、或非门
C、异或门
D、触发器
3.单项选择题时序逻辑电路的计数器直接取相应进制数经相应门电路送到()端。
A、异步清零端
B、同步清零端
C、异步置数端
D、同步置数端
4.单项选择题时序逻辑电路的计数控制端无效,则电路处于()状态。
A、计数
B、保持
C、置1
D、置0
5.单项选择题JK触发器,当JK为()时,触发器处于翻转状态。
A、00
B、01
C、10
D、11
6.单项选择题由与非门组成的可控RS触发器,当RS为()时,触发器处于不定状态。
A、00
B、01
C、10
D、11
7.单项选择题集成译码器无法工作,首先应检查()的状态。
A、输入端
B、输出端
C、清零端
D、使能端
8.单项选择题集成编码器的()状态不对时,编码器无法工作。
A、输入端
B、输出端
C、清零端
D、控制端
9.单项选择题两片集成计数器74LS192,最多可构成()进制计数器。
A、100
B、50
C、10
D、9
10.单项选择题当集成译码器74LS138的3个使能端都满足要求时,其输出端为()有效。
A、高电平
B、低电平
C、高阻
D、低阻
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