单项选择题下列触发器中，（）不可作为同步时序逻辑电路的存储元件。
A.基本R-S触发器
B.D触发器
C.J-K触发器
D.T触发器
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1.单项选择题构造一个模10同步计数器，需要（）触发器。
A.3个
B.4个
C.5个
D.10个
2.单项选择题同步时序电路设计中，状态编码采用相邻编码法的目的是（）
A.减少电路中的触发器
B.提高电路速度
C.提高电路可靠性
D.减少电路中的逻辑门
3.单项选择题电平异步时序逻辑电路不允许两个或两个以上输入信号（）
A.同时为0
B.同时为1
C.同时改变
D.同时出现
4.多项选择题脉冲异步时序逻辑电路的输入信号可以是（）
A.模拟信号
B.电平信号
C.脉冲信号
D.时钟脉冲信号
5.多项选择题脉冲异步时序逻辑电路中的存储元件可以采用（）
A.时钟控制RS触发器
B.D触发器
C.基本RS触发器
D.JK触发器
6.单项选择题八路数据选择器应有（）个选择控制器。
A.2
B.3
C.6
D.8
7.单项选择题移位寄存器T1194工作在并行数据输入方式时，MAMB取值为（）
A.00
B.01
C.10
D.11
8.单项选择题
半导体存储器（）的内容在掉电后会丢失。
A.A
B.B
C.C
D.D
9.单项选择题用PLA进行逻辑设计时，应将逻辑函数表达式变换成（）
A.异或表达式
B.与非表达式
C.最简“与—或”表达式
D.标准“或—与”表达式
10.单项选择题补码1.1000的真值为（）
A.+1.1000
B.-1.1000
C.-0.1000
D.-0.0001
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十进制数178.5对应的余3码是（）。
题型：单项选择题
如图电路实现的逻辑函数是（）。
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若集成块内部为驱动单元提供的驱动能力为1X，最小反相器（1X）延迟时间为2，对于下图所示的输出缓冲设计（图中反相器上面标注了相应的驱动能力），该输出单元的延迟时间（从a到y）最接近于（）。
题型：单项选择题
如图所示电路论述正确的是（）。
题型：多项选择题
数字设计的层次主要有（）。
题型：多项选择题
当共阴极7段数码管显示2的时候，输出应该为（）。
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十进制数22.37对应的二进制数是（）。
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若n个变量的同或运算和异或运算结果相同，则n为奇数（）
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TTL门电路具有负载能力强、抗干扰能力强和转换速度高等特点。
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