下列哪个函数与逻辑函数F=A⊙B不等（）
A.A
B.B
C.C
D.D
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A.PROM的或门阵列
B.PAL的与门阵列
C.PLA的与门阵列和或门阵列
D.PROM的与门阵列
A.4位计数器T4193
B.4位并行加法器T693
C.4位寄存器T1194
D.4位数据选择器T580
A.原码
B.补码
C.Gray码
D.反码
A.101101101
B.010101010101
C.100010001000
D.010101011000
A.与非门
B.或非门
C.或门
D.与或非门
n个变量构成的最小项mi和最大项Mi之间，满足关系（）
A.A
B.B
C.C
D.D
A.1个
B.8个
C.10个
D.16个
或非门构成的基本RS触发器，输入端SR的约束条件是（）
A.A
B.B
C.C
D.D
A.3
B.6
C.8
D.1
A.5
B.6
C.10
D.53
最新试题
如图，是151的电路设计，其中输入端的使用了6个反相器，而实现逻辑功能应该可以省掉三个，为什么这么设计（）。
如图电路，描述正确的是（）。
利用开关代数的公理或定理，判断与（x+y’）’等价的逻辑关系为（）。
若集成块内部为驱动单元提供的驱动能力为1X，对于下图所示的输出缓冲设计（图中反相器上面标注了相应的驱动能力），该输出单元的延迟时间（从a到y）相当于（）个内部标准门级联的延迟时间。
如图所示，则F=（）。
使用74HC138实现逻辑函数正确的是（）。
如图电路实现的逻辑函数是（）。
已知有二输入逻辑门，只有当输X和Y都为1时，输出F才为1，则X，Y与F的逻辑关系为（）。
BCD码译码器如果不允许输入大于9的数值的时候，当输入10时，输出为（）。
若集成块内部为驱动单元提供的驱动能力为1X，最小反相器（1X）延迟时间为2，对于下图所示的输出缓冲设计（图中反相器上面标注了相应的驱动能力），该输出单元的延迟时间（从a到y）最接近于（）。