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问答题 有一时序逻辑的原始状态图如题图所示，请将这一原始状态图转换成原始状态表，用隐含表进行化简，并列出简化状态表。

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1.问答题 所用隐含表将题表的原始状态表化简，并列出简化状态表。

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2.问答题 所用隐含表将题表的原始状态表化简，并列出简化状态表。

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3.问答题试用两片集成中规模异步十进制计数器CT7490和必要的门电路设计一个模24进制计数器。

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4.问答题试用两片CT74161设计一个分频电路，电路采用M＝9×12的形式，芯片Ⅱ的输出端和时钟CP的分频比为1/108。请分别列出各片的状态转移真值表并画出逻辑电路图。

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5.问答题用两片CT74163芯片设计M＝53计数器，画出电路图，列出每片状态转移表，并简单说明设计思路。

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6.问答题用两片CT74160芯片设计M＝36计数器，画出电路图，列出每片状态转移表，并简单说明设计思路。

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7.问答题用一片集成4位二进制计数器CT74161和必要的门电路设计一个可变模值计数器，当A＝0时，实现模8；当A＝1时，实现模6。简要说明设计思路，画出逻辑图。

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8.问答题用集成同步十进制加法计数器CT74160，设计一个七进制计数器，列出状态转移表，并画出逻辑图。

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9.问答题 分析题图所示由集成4位二进制计数器CT74161和集成2线-4线译码器构成的电路；设时钟脉冲CP的频率f_CP=90kHZ，说明当译码器的地址输入AB分别为00、01、10、11时，CT7461的输出CO的频率f各是多少？

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10.问答题 分析题图所示用集成同步4位二进制计数器CT74161构成的计数器电路，列出状态转移表，说明计数模值，并分别画出题图（a）、题图（b）中Z₁和Z₂的波形。

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