问答题

电路如图所示,Rb1=Rb2=5kΩ,Rc1=Rc2=30kΩ,Re=20kΩ,T1和T2的性能一致,+Vcc=+15V,-Vcc=-15V;rbc1=rbc2=4kΩ,β12=50;UBEQ=0.7V。试求:
1)求静态工作点即IBQ,ICQ,UCQ
2)求Aud,Rid,Rod
3)电路改成从T2的集电极与地之间输出时Aud


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6.单项选择题理想运放的两个重要结论是()

A.虚地与反相
B.虚短与虚地
C.虚短与虚断
D.断路与短路

最新试题

可以通过新增以下哪些类型文件添加ChipScope调试IP核?()

题型:多项选择题

现在定义了一个1位的加法器addbit(ci,a,b,co,sum),模块的结果用表达式表示为{co,sub}=a+b+ci,其中a,b为两个加数,ci为来自低位的进位,sum为和,co为向高位的进位,如果以此1位加法器构建四位加法器,同时定义顶层模块中的端口信号和中间变量的定义:下面通过层次调用的方式进行逻辑实现中的表达式正确的是()。

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‌CS放大器中引入源极电阻RS,其作用有()。‎

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‍verilogHDL的基本结构中通常需要进行模块范围的定义,VerilogHDL的模块范围的定义的开始和结束方式是()。

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‌5.1K±5%欧姆的五环电阻的色环序列为()。

题型:单项选择题