判断题D/A转换器的最大输出电压的绝对值可达到基准电压VREF。
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1.单项选择题将一个时间上连续变化的模拟量转换为时间上(离散的模拟量的过程称为()。
A.采样
B.量化
C.保持
D.编码
2.问答题
用1024×1的RAM接成1024×8的RAM。
5.单项选择题PROM的与陈列(地址译码器)是()。
A.全译码可编程阵列
B.全译码不可编程阵列
C.非全译码可编程阵列
D.非全译码不可编程阵列
6.单项选择题欲将容量为256×1的RAM扩展为1024×8,则需要控制各片选端的辅助译码器的输入端数为()。
A.4
B.2
C.3
D.8
7.单项选择题欲将容量为128×1的RAM扩展为1024×8,则需要控制各片选端的辅助译码器的输出端数为()。
A.1
B.2
C.3
D.8
8.单项选择题若RAM的地址码有8位,行、列地址译码器的输入端都为4个,则它们的输出线(即字线加位线)共有()条。
A.8
B.16
C.32
D.256
9.单项选择题寻址容量为16K×8的RAM需要()根地址线。
A.4
B.8
C.14
D.16
E.16K
10.单项选择题要构成容量为4K×8的RAM,需要()片容量为256×4的RAM。
A.2
B.4
C.8
D.32
最新试题
若集成块内部为驱动单元提供的驱动能力为1X,最小反相器(1X)延迟时间为2,对于下图所示的输出缓冲设计(图中反相器上面标注了相应的驱动能力),该输出单元的延迟时间(从a到y)最接近于()。
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如图,是151的电路设计,其中输入端的使用了6个反相器,而实现逻辑功能应该可以省掉三个,为什么这么设计()。
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输出端不能直接线与的门电路有()。
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如图电路实现的逻辑函数是()。
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如图,此电路的输入端I0_L是低电平有效,输出A2A1A0是高电平有效,AVALID有效表示的是()。
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若n个变量的同或运算和异或运算结果相同,则n为奇数()
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利用开关代数的公理或定理,判断与(x+y’)’等价的逻辑关系为()。
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构成数字电路最基本的器件主要有()。
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逻辑函之间满足()关系。
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数字设计的层次主要有()。
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