问答题试用VHDL设计一个半加器,要求采用布尔方程描述方法。
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6.多项选择题出现下列五种逻辑门中哪几种的输出可以并联使用。()
A.TTL集电极开路门;
B.普通具有推拉式输出的TTL与非门;
C.TTL三态输出门;
D.普通CMOS门;
E.CMOS三态输出门。
7.问答题
试画出实现如下功能的CMOS电路图。
10.问答题
用列表法化简逻辑函数
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BCD码译码器如果不允许输入大于9的数值的时候,当输入10时,输出为()。
题型:单项选择题
CC4000系列的CMOS门电路不能直接接()系列的门电路。
题型:单项选择题
要使CMOS门输入高电平,不能使用的方法为()。
题型:单项选择题
如图所示电路论述正确的是()。
题型:多项选择题
若集成块内部为驱动单元提供的驱动能力为1X,最小反相器(1X)延迟时间为2,对于下图所示的输出缓冲设计(图中反相器上面标注了相应的驱动能力),该输出单元的延迟时间(从a到y)最接近于()。
题型:单项选择题
关于集成块的输出单元,下列说法中正确的是()。
题型:多项选择题
输出端不能直接线与的门电路有()。
题型:单项选择题
十进制数22.37对应的二进制数是()。
题型:单项选择题
为实现将D触发器转换为T触发器,下图所示电路的虚框内应是()。
题型:单项选择题
两个二进制数的补码相加,有溢出的是()。
题型:多项选择题