A.一级多米诺逻辑由一个动态逻辑门和一个静态反相逻辑门串联而成
B.彼此串联的一组多米诺逻辑的预充和求值是并行进行的,因此速度很快
C.多米诺逻辑工作的最高时钟频率主要由各级门的求值时间之和决定
D.为了提高性能,多米诺逻辑中的输出反相器往往采用high-skew反相器
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A.VDD/2
B.阈值电压VT
C.VDD
D.VDD-VT
A.互补CMOS逻辑门的下降速度更快,静态功耗更高
B.互补CMOS逻辑的下降速度更快,静态功耗更低
C.伪NMOS逻辑的下降速度更快,静态功耗更高
D.伪NMOS逻辑的下降速度更快,静态功耗更低
A.在芯片当中的任一位置上放置一个电容
B.靠近大的驱动器的地方应该放置去耦电容
C.电源线下方应该放置去耦电容
D.尽量远离要稳定的电源电压的电路
A.可以减小各处电路的电源/地线上的寄生电阻
B.可以减小流过电源/地线上的电流
C.可以使得芯片各处的电源/地线上的寄生电阻相等
D.增大导线的对地电容,滤除电压的波动
A.耦合电容更大
B.干扰信号摆幅大
C.受害信号线是低阻抗节点(被低的驱动电阻驱动)
D.干扰信号翻转速度快
A.1
B.2
C.3
D.0
A.集总电容模型
B.分布rc模型
C.集总RC模型
D.看作理想导线
A.电源
B.地
C.时钟
D.数据信号
A.绝缘层的厚度
B.导线的宽度
C.导线之间的线间距
D.金属层的厚度
A.应该充分降低VDD
B.能耗与VDD不是单调关系,存在一个最优的电源电压
C.过低的VDD会引起静态能耗增加
D.最优的VDD通常小于晶体管的阈值电压
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